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控制電路根據(jù)邏輯關系可以分為組合電路和時序電路，在一個復雜的控制電路中可能包含了這兩種電路。
組合電路的設計
控制結果只和輸入有關的電路叫組合電路，由于組合電路的控制結果只和輸入變量的狀態(tài)有關，所以，可以用邏輯代數(shù)通過計算得出。
組合電路梯形圖設計步驟一般如下：
（1）根據(jù)控制條件列出真值表。
（2）由真值表寫出邏輯表達式并進行簡化。
（3）根據(jù)邏輯表達式畫梯形圖。
例如將樓梯走廊內一個普通的雙控開關用plc來進行控制，設計出plc控制接線圖和梯形圖。
a.根據(jù)要求畫出plc接線如圖。
為防止plc和變頻器之間的控制信號線受空間電磁場的干擾，可在這些控制信號線的外層接屏蔽線，以提高系統(tǒng)的抗*力。此種接線一定要注意，對屏蔽的接地點只能選取一點。不管是在PLC一邊，還是在變頻器的一邊。一般選在信號接收端，即變頻器一邊。這樣，可提高系統(tǒng)的抗*力。如果屏蔽線在兩端都接地，會使屏蔽線上有電流流過，不但不能提高系統(tǒng)的抗干擾的能力，反而會加重外界對PLC的干擾。
plc接線圖
b.按照題意得知兩個開關有4種狀態(tài)，當只有其中一個開關動作的時候燈亮，當兩個開關都動作或者都不動作的時候燈不亮，畫出真值表。
為防止plc和變頻器之間的控制信號線受空間電磁場的干擾，可在這些控制信號線的外層接屏蔽線，以提高系統(tǒng)的抗*力。此種接線一定要注意，對屏蔽的接地點只能選取一點。不管是在PLC一邊，還是在變頻器的一邊。一般選在信號接收端，即變頻器一邊。這樣，可提高系統(tǒng)的抗*力。如果屏蔽線在兩端都接地，會使屏蔽線上有電流流過，不但不能提高系統(tǒng)的抗干擾的能力，反而會加重外界對PLC的干擾。
真值表
由真值表寫出邏輯表達式
E=s2非s1+s2s1非
c.根據(jù)邏輯表達式畫出梯形圖。
為防止plc和變頻器之間的控制信號線受空間電磁場的干擾，可在這些控制信號線的外層接屏蔽線，以提高系統(tǒng)的抗*力。此種接線一定要注意，對屏蔽的接地點只能選取一點。不管是在PLC一邊，還是在變頻器的一邊。一般選在信號接收端，即變頻器一邊。這樣，可提高系統(tǒng)的抗*力。如果屏蔽線在兩端都接地，會使屏蔽線上有電流流過，不但不能提高系統(tǒng)的抗干擾的能力，反而會加重外界對PLC的干擾。
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